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        用Verilog hdl來實現d觸發器2分頻程序源碼

        作者:huqin   來源:本站原創   點擊數:  更新時間:2014年05月03日   【字體:

        用Verilog來實現d觸發器2分頻的Verilog hdl程序:

        module dff_2(clk,rst,clk_out);

        input clk,rst;
        output clk_out;

        wire clk,rst;
        reg clk_out;

        always @(posedge clk or negedge rst)
         if(!rst)
          begin
           clk_out<=0;
          end
         else
          begin
           clk_out<=~clk_out;
          end

        endmodule 
        通過RTL viewer  得到的原理圖;

         

         

        仿真圖如圖示:

         



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